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a21536a60e
commit
b795a22f6a
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@ -57,7 +57,6 @@ char *output_file_name = NULL;
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srslte_cell_t cell = {
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25, // nof_prb
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1, // nof_ports
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0, // bw idx
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0, // cell_id
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SRSLTE_CP_NORM, // cyclic prefix
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SRSLTE_PHICH_R_1, // PHICH resources
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@ -37,7 +37,6 @@ char *input_file_name = NULL;
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srslte_cell_t cell = {
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6, // nof_prb
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2, // nof_ports
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0, // bw_idx
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150, // cell_id
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SRSLTE_CP_NORM, // cyclic prefix
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SRSLTE_PHICH_R_1, // PHICH resources
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@ -39,7 +39,6 @@ char *matlab_file_name = NULL;
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srslte_cell_t cell = {
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6, // nof_prb
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1, // nof_ports
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||||
0, // bw_idx
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0, // cell_id
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SRSLTE_CP_NORM, // cyclic prefix
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SRSLTE_PHICH_R_1, // PHICH resources
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@ -37,7 +37,6 @@ char *input_file_name = NULL;
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srslte_cell_t cell = {
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6, // cell.cell.cell.nof_prb
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1, // cell.cell.nof_ports
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0, // bw_idx
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0, // cell.id
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SRSLTE_CP_NORM, // cyclic prefix
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SRSLTE_PHICH_R_1, // PHICH resources
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@ -37,7 +37,6 @@ char *input_file_name = NULL;
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srslte_cell_t cell = {
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6, // nof_prb
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||||
1, // nof_ports
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0, // bw_idx
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0, // cell_id
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SRSLTE_CP_NORM, // cyclic prefix
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SRSLTE_PHICH_R_1, // PHICH resources
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@ -39,7 +39,6 @@
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srslte_cell_t cell = {
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6, // nof_prb
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1, // nof_ports
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0,
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0, // cell_id
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SRSLTE_CP_NORM, // cyclic prefix
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SRSLTE_PHICH_R_1_6, // PHICH resources
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@ -38,7 +38,6 @@ char *matlab_file_name = NULL;
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srslte_cell_t cell = {
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50, // cell.nof_prb
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||||
2, // cell.nof_ports
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||||
2, // bw_idx
|
||||
150, // cell.id
|
||||
SRSLTE_CP_NORM, // cyclic prefix
|
||||
SRSLTE_PHICH_R_1, // PHICH resources
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||||
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@ -36,7 +36,6 @@
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|||
srslte_cell_t cell = {
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||||
25, // nof_prb
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||||
1, // nof_ports
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2, // bw_idx = 5 MHz
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||||
1, // cell_id
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SRSLTE_CP_NORM, // cyclic prefix
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SRSLTE_PHICH_R_1_6, // PHICH resources
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